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- Logical address
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목록cache side-channel (3)
컴공과블로그
Prime+Abort : A Timer-Free High-Precision L3 Cache Attack using Intel TSX
Disselkoen, Craig, et al. "{Prime+ Abort}: A {Timer-Free}{High-Precision} L3 Cache Attack using Intel {TSX}." 26th USENIX Security Symposium (USENIX Security 17). 2017. https://www.usenix.org/conference/usenixsecurity17/technical-sessions/presentation/disselkoen Prime+Abort: A Timer-Free High-Precision L3 Cache Attack using Intel TSX | USENIX Open Access Media USENIX is committed to Open Access ..
PRIME+PROBE: Last-Level Cache Side-Channel Attacks are Practical (2)
Create Eviction Set 다음은 Eviction set을 만드는 algorithm입니다. Eviction set에 들어갈 수 있을법한 candidate memory line을 input으로 가져오고 output으로 Eviction set을 내보냅니다. candidate memory line들을 체크해보며 conflict가 발생하는지 확인한다. 그리고 memory line들이 들어있는 set을 확인해보며 LLC에서 eviction이 발생하는지 찾는다. conflict set을 만들어주는데, 여기에는 conflict가 이루어지지 않는 line들도 넣고 memory slice에서 conflict가 발생하는 부분도 넣는다. 그렇게 함으로 eviction set의 unicon을 만들 수 있다. 그 후 ..
Flush+Flush: A Fast and Stealthy Cache Attack
Gruss, D., Maurice, C., Wagner, K., & Mangard, S. (2016). Flush+ flush: A fast and stealthy cache attack. In Detection of Intrusions and Malware, and Vulnerability Assessment: 13th International Conference, DIMVA 2016, San Sebastián, Spain, July 7-8, 2016, Proceedings 13 (pp. 279-299). Springer International Publishing. 해당 논문은 FLUSH+RELOAD 이후에 나온 FLUSH+FLUSH 논문으로 새로운 Cache Side-channel 공격의 등장이었다..